對模擬電路中上下拉電阻作用的一點小總結
發布時間：2016-9-20 10:37
發布者：designapp
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一、定義 上拉是對器件注入電流，下拉是輸出電流;弱強只是上拉電阻的阻值不同，沒有什么嚴格區分;對于非集電極(或漏極)開路輸出型電路(如普通門電路)提升電流和電壓的能力是有限的，上拉電阻的功能主要是為集電極開路輸出型電路輸出電流通道。 二、上下拉電阻作用： 1、提高電壓準位：a.當TTL電路驅動COMS電路時，如果TTL電路輸出的高電平低于COMS電路的最低高電平(一般為3.5V)， 這時就需要在TTL的輸出端接上拉電阻，以提高輸出高電平的值。b.OC門電路必須加上拉電阻，以提高輸出的搞電平值。 2、加大輸出引腳的驅動能力，有的單片機管腳上也常使用上拉電阻。 3、N/A pin防靜電、防干擾：在COMS芯片上，為了防止靜電造成損壞，不用的管腳不能懸空，一般接上拉電阻產生降低輸入阻抗， 提供泄荷通路。同時管腳懸空就比較容易接受外界的電磁干擾。 4、電阻匹配，抑制反射波干擾：長線傳輸中電阻不匹配容易引起反射波干擾，加上下拉電阻是電阻匹配，有效的抑制反射波干擾。 5、預設空間狀態/缺省電位：在一些 CMOS 輸入端接上或下拉電阻是為了預設缺省電位. 當你不用這些引腳的時候, 這些輸入端下拉接 0 或上拉接 1。在I2C總線等總線上，空閑時的狀態是由上下拉電阻獲得 6. 提高芯片輸入信號的噪聲容限：輸入端如果是高阻狀態，或者高阻抗輸入端處于懸空狀態，此時需要加上拉或下拉，以免收到隨機電平而影響電路工作。同樣如果輸出 端處于被動狀態，需要加上拉或下拉，如輸出端僅僅是一個三極管的集電極。從而提高芯片輸入信號的噪聲容限增強抗干擾能力。 {電源到元件間的叫上拉電阻,作用是平時使該腳為高電平 地到元件間的叫下拉電阻,作用是平時使該腳為低電平 上拉電阻和下拉電阻的范圍由器件來定(我們一般用10K) +Vcc +------+=上拉電阻 |+-----+ |元件| |+-----+ +------+=下拉電阻 -Gnd 一般來說上拉或下拉電阻的作用是增大電流，加強電路的驅動能力 比如說51的p1口 還有，p0口必須接上拉電阻才可以作為io口使用 上拉和下拉的區別是一個為拉電流，一個為灌電流 一般來說灌電流比拉電流要大 也就是灌電流驅動能力強一些} 三、上拉電阻阻值的選擇原則包括: 1、從節約功耗及芯片的灌電流能力考慮應當足夠大;電阻大，電流小。 2、從確保足夠的驅動電流考慮應當足夠小;電阻小，電流大。 3、對于高速電路，過大的上拉電阻可能邊沿變平緩。綜合考慮 以上三點,通常在1k到10k之間選取。對下拉電阻也有類似道理 四、原理： 上拉電阻實際上是集電極輸出的負載電阻。不管是在開關應用和模擬放大，此電阻的選則都不是拍腦袋的。工作在線性范圍就不多說了，在這里是討論的是晶體管是開關應用，所以只談開關方式。找個TTL器件的資料單獨看末級就可以了，內部都有負載電阻根據不同驅動能力和速度要求這個電阻值不同，低功耗的電阻值大，速度快的電阻值小。但芯片制造商很難滿足應用的需要不可能同種功能芯片做許多種。 |
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