EEPROM接口的FPGA實現_fpga資料_明德揚至簡設計法
發布時間：2017-8-2 15:23
發布者：mdykj33
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工程說明 AT93C46在DI接收到讀指令時，地址被解碼，數據在DO引腳上串行輸出。寫周期是完全自主調時的，在寫入之前不需要單獨的擦除周期。本項目要求AT93C46完成讀和寫功能的混合功能。 案例補充說明 本案例要求實現一個AT93C46的接口能夠根據命令，實現EWEN、WRITE和READ功能，在這里我們提供了具體的設計思路： 1. 上游模塊在rdy=1時，給出start命令，開始進行EWEN、WRITE或者READ操作；在rdy=0期間，start命令無效。 2. 當start有效時，如果mode=0表示進行EWEN操作；mode=1表示進行WRITE操作；mode=2表示進行READ操作。 3. 當start有效時，addr和wdata有效。 4. 當進行EWEN操作時，將addr寫入at93c46。 5. 當進行WRITE操作時，將addr和wdata寫入at93c46。 當進行READ操作時，將addr寫入at93c46，并從at93c46讀到數據，通過rdata和rdata_vld返回給上游模塊。代碼文檔說明 
EEPROM接口的FPGA實現.rar
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